2018-11 Xilinx Seminar Image Processing DE

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Image Processing Solutions for Xilinx Seminar

15 May 2018 - 22 Nov 2018

Germany, Multiple Dates / Locations


Ein Anwendungsgebiet, in dem FPGAs, SoCs und MPSoCs sehr erfolgreich eingesetzt werden, ist die Bildverarbeitung. Doch der Einstieg in die Bildverarbeitung mit diesen Bausteinen kann einige Hürden aufweisen, die gemeistert werden müssen. Es gibt jedoch von XILINX einige Designtools, die uns bei der Entwicklung von Bildverarbeitungssystemen helfen können. Bereits vorhandene IP Cores können aus dem Vivado IP Katalog ausgewählt werden oder wir können mit Hilfe von Vivado HLS oder SDSoC schnell in C/C++ programmierte Algorithmen aufbauen und für ein FPGA synthetisieren.

Des Weiteren stehen uns in der Vivado High Level Synthesis auch einige OpenCV Funktionen zur Verfügung, die für die Implementierung im FPGA, SoC oder MPSoC optimiert wurden. Dieses Seminar gibt einen Überblick in die Bildverarbeitung auf XILINX FPGAs, SoCs und MPSoCs. Zuerst werden die bereits in Vivado vorhandenen Image Processing IP Cores besprochen, die für die Erstellung von Bildverarbeitungssystemen verwendet werden können.

Weiterhin wird diskutiert, wie wir mittels Vivado HLS eigene Video IPs aufbauen können und es wird gezeigt wie vorhandenen OpenCV Funktionen in ein HLS designintegriert werden können. Dabei wird auch auf den Softwareentwickler eingegangen, der mit Hilfe der High Level Synthese und dem SDSoC Tool in der Lage ist C/C++ Software Algorithmen auf FPGA Hardware zu beschleunigen. Das Seminar ist praktisch aufgebaut und es wird in Beispielen gezeigt wie ein Kamerasystem mittels fertiger IP und HLS IP cores aufgebaut werden kann.

Termine

  • 15.05.18 - Hannover
  • 20.09.18 - München
  • 22.11.18 - Stuttgart

Anwendbare Technologien
7-Series Families oder neuere

Vorraussetzungen

  • Grundkenntnisse der FPGA-Technologie sind hilfreich
  • Grundkenntnisse von Vivado sind hilfreich
  • Grundkenntnisse VHDL
  • Grundkenntnisse C/C++ sind hilfreich

Agenda

  • Introduction
  • Overview
  • Available IP Cores for Image Processing
  • Camera Interface Overview
  • Vivado HLS and SDSoC for Image Processing
  • Demo

Contact

Alexander Friebe
(Supplier Line Manager XILINX)
Email: Alexander.Friebe@avnet.eu

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