Ultra96を使ったMPSoCハードウェア開発入門

15 Oct 2019 - 22 Nov 2019

東京・大阪


使用ボード

  • Avnet Ultra96

 

使用ツール

  • Vivado 2018.3
  • SDK 2018.3

 

対象

  • Zynq UltraScale+ MPSoCデバイスで作成したシステムがどのように動作するのかを知りたい方
  • Zynq UltraScale+ MPSoCデバイスの概要・内部構成などを知りたい方
  • Zynq UltraScale+ MPSoCデバイスの基本的なハードウェアデザインの設計方法・開発フローを知りたい方
  • Zynq UltraScale+ MPSoCデバイスでのハードウェア開発を体験したい方

  *本トレーニングは、これからMPSoCハードウェアプラットフォームの作成を考えられている初心者の方を対象としています。

 

コース内容

  • 時間:10:00-18:00 (終了時刻は予定)
     
  • このコースでは、Zynq UltraScale+ MPSoC アーキテクチャやザイリンクスVivadoツールを使用したハードウェアプラットフォームの開発方法を学習します。
  • FPGA開発ツールであるVivadoは、クロック、メモリインターフェイス、ペリフェラルなどの各種システムパラメーターの設定およびデバイス内部のFPGAブロック(Programable Logic)でカスタムハードウェアを開発するためにも使用され、そのための基本操作も説明します。
  • 演習として、 Ultra96 / Ultra96-V2 ボード上でコードを実行する実用的なハードウェアプラットフォームを構築します。
  • 以下に概要を示します。
    • VivadoのIPインテグレーターを使用したZynq UltraScale+ MPSoC開発フローの概要
    • ARM Cortex™-A53プロセッサを含むZynq UltraScale+ MPSoCアーキテクチャの概要
    • ザイリンクスのエンベデッドシステムツールを活用して、Zynq UltraScale+ MPSoCシステムを設計する方法
    • ザイリンクスとカスタムIPを追加方法
    • IPをテストするためにソフトウェアアプリケーションを実行する方法
    • 組み込みシステムをデバッグする方法

 

講義:

  • 第1章 システムオンチップ(SoC)の使用ケース
  • 第2章 Zynq MPSoC プロセッサー 概要
  • 第3章 ペリフェラル
  • 第4章 TCLのパワー
  • 第5章 プロセッシングシステム(PS)とプログラムロジック(PL)の結合
  • 第6章 Zynq UltraScale+ DMA
  • 第7章 カスタムIPの作成
  • 第8章 Vivadoハードウェアマネージャー
  • 第9章 TCLスクリプト
  • 第10章 次のステップ
  • 各章に対応した演習の実施

 

受講費用

  • 有料:2TC (特価 期間限定:2020年3月開催分まで)
       4TC (定価 通常価格:2020年4月開催分より)

 

参加条件

  以下いずれかの条件にあてはまる方

  • Avnet開催の"Ultra96を使ったMPSoCソフトウェア開発入門"を受講された方
  • HDLAB社主催の"Zynq UltraScale+ MPSoC ソフトウェアデザイン"を受講された方
  • MPSoCによるソフトウェア開発経験のある方

 

開催予定

  東京 大阪
2019年9月 9日(月) 受付終了    19日(木) 受付終了   
2019年10月 25日(金)         15日(火)        
2019年11月 18日(月)         22日(金)        

 

本トレーニングコースの受講をご希望の方は、専用のフォームよりお申し込みください。コース受講の可否については、原則として1営業日以内にメールでご連絡いたします。ただし、17時以降のお申込みにいては、翌営業日のお申込みとしてお取り扱いさせていただきます。

 

お問い合わせ

本トレーニングに関するお問い合わせはこちらから
 

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